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AS4C128M8D3LB-12BCN

Name: Alliance Memory AS4C128M8D3LB-12BCN
Brand: Alliance Memory
SKU: 913-A4C1288D3LB12BCN
Price: 14.12 USD
Availability: InStock

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Mouser N.º:

913-A4C1288D3LB12BCN

Fabricante N.º:

AS4C128M8D3LB-12BCN

Fabricante:

Alliance Memory

Descripción:

DRAM DDR3, 1G, 128M x 8, 1.35V, 78-ball BGA, 800MHz, (B die), Commercial Temp - Tray

Hoja de datos:

AS4C128M8D3LB-12BCN Hoja de datos (PDF)

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	$13.09	$130.90
	$12.68	$317.00
	$12.08	$604.00
	$11.78	$1,178.00
	$11.60	$2,807.20
	$11.31	$5,474.04

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Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Alliance Memory
Categoría de producto:	DRAM
RoHS:
Tipo:	SDRAM - DDR3L
Tamaño de memoria:	1 Gbit
Ancho de bus de datos:	8 bit
Frecuencia de reloj máxima:	800 MHz
Paquete / Cubierta:	FBGA-78
Organización:	128 M x 8
Tiempo de acceso:	225 ps
Voltaje de alimentación - Mín.:	1.283 V
Voltaje de alimentación - Máx.:	1.45 V
Temperatura de trabajo mínima:	0 C
Temperatura de trabajo máxima:	+ 95 C
Serie:	AS4C128M8D3LB
Empaquetado:	Tray
Marca:	Alliance Memory
País de ensamblaje:	TW
País de difusión:	TW
País de origen:	TW
Sensibles a la humedad:	Yes
Estilo de montaje:	SMD/SMT
Tipo de producto:	DRAM
Cantidad de empaque de fábrica:	242
Subcategoría:	Memory & Data Storage
Corriente de suministro - Máx.:	72 mA

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REACH Declaration (PDF)

CAHTS:: 8542320020
USHTS:: 8542320032
MXHTS:: 8542320201
ECCN:: EAR99

DDR3 Synchronous DRAM

Alliance Memory DDR3 Synchronous DRAM (SDRAM) achieves high-speed double-data-rate transfer rates of up to 1600Mb/sec/pin for general applications. The chip is designed to comply with all key DDR3 DRAM key features, and all of the control and address inputs are synchronized with a pair of externally supplied differential clocks. Inputs are latched at the cross point of differential clocks (CK rising and CK# falling). All I/Os are synchronized with differential DQS pairs in a source synchronous fashion. These Alliance Memory devices operate with a single 1.5V ± 0.075V power supply and are available in BGA packages.

DDR3L SDRAM

Alliance Memory DDR3L SDRAM uses a double data rate architecture to achieve high-speed operation. The double data rate architecture is an 8n-prefetch architecture with an interface that transfers two data words per clock cycle at the I/O pins. A single read or write operation for the DDR3 SDRAM effectively consists of a single 8n-bit-wide, four-clock-cycle data transfer at the internal DRAM core and eight corresponding n-bit-wide, one-half-clock-cycle data transfers at the I/O pins. Alliance Memory DDR3L SDRAM is available in various package sizes.