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CDCU877RHAT

Name: Texas Instruments CDCU877RHAT
Brand: Texas Instruments
SKU: 595-CDCU877RHAT
Price: 11.76 USD
Availability: InStock

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Mouser N.º:

595-CDCU877RHAT

Fabricante N.º:

CDCU877RHAT

Fabricante:

Texas Instruments

Descripción:

Emisores y distribución de reloj 1.8v PLL Clock Drive r A 595-CDCU877RHAR A 595-CDCU877RHAR

Hoja de datos:

CDCU877RHAT Hoja de datos

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$-.--

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$-.--

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Empaque:

Envase tipo carrete completo (pedir en múltiplos de 250)

Cinta cortada

MouseReel™ (+$7.00)

Precio (USD)

Cantidad	Precio unitario	Precio ext.
Cinta cortada / MouseReel™ ^†
	$11.76	$11.76
	$9.22	$92.20
	$8.59	$214.75
	$7.89	$789.00
Envase tipo carrete completo (pedir en múltiplos de 250)
	$7.56	$1,890.00
	$7.26	$3,630.00
	$7.15	$7,150.00
5,000	Presupuesto

† $7.00 Se agregará y calculará la tarifa de MouseReel™ en su carrito de compras. Ningún artículo de MouseReel™ se puede cancelar ni devolver. ↩

.hidden-for-nojs { display: none; } .pull-right-nojs { justify-content: flex-end; }

Atributo del producto	Valor de atributo	Seleccionar atributo
Fabricante:	Texas Instruments
Categoría de producto:	Emisores y distribución de reloj
RoHS:
Tipo de salida:	SSTL-18
Frecuencia de salida máx.:	400 MHz
Tipo de entrada:	SSTL-18
Paquete / Cubierta:	VQFN-40
Voltaje de alimentación - Mín.:	1.7 V
Voltaje de alimentación - Máx.:	1.9 V
Serie:	CDCU877
Temperatura de trabajo mínima:	- 40 C
Temperatura de trabajo máxima:	+ 85 C
Empaquetado:	Reel
Empaquetado:	Cut Tape
Empaquetado:	MouseReel
Marca:	Texas Instruments
Sensibles a la humedad:	Yes
Estilo de montaje:	SMD/SMT
Corriente de suministro operativa:	135 mA
Producto:	Clock Drivers
Tipo de producto:	Clock Drivers & Distribution
Cantidad de empaque de fábrica:	250
Subcategoría:	Clock & Timer ICs
Tipo:	Phase-Locked-Loops (PLLs) and Oscillators
Peso de la unidad:	104 mg

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CNHTS:: 8542319090
CAHTS:: 8542390000
USHTS:: 8542390090
JPHTS:: 8542390990
TARIC:: 8542399000
MXHTS:: 85423999
ECCN:: EAR99

CDCU877 Phase-Lock Loop Clock Driver

Texas Instruments CDCU877 Phase-Lock Loop Clock Driver is a high-performance, low-jitter, low-skew, zero-delay buffer. It distributes a differential clock input pair (CK, /CK) to 10 differential pairs of clock outputs (Yn, /Yn) and one differential pair of feedback clock outputs (FBOUT, /FBOUT). The clock outputs are controlled by the input clocks (CK, /CK), the feedback clocks (FBIN, /FBIN), the LVCMOS control pins (OE, OS), and the analog power input (AV_DD). When OE is low, the clock outputs, except FBOUT, /FBOUT, are disabled while the internal PLL maintains its locked-in frequency. OS (output select) is a program pin that must be tied to GND or V_DD. When OS is high, OE functions as previously described. When OS and OE are both low, OE does not affect Y7, /Y7, as these are free-running. When AV_DD is grounded, the PLL is turned off and bypassed for test purposes.